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3f2b4d7220
Add i.MX8ULP EVK basic support, support SD/I2C/ENET/LPUART Log as below: I would keep some debug info for now, and after we move to be stable and production launch, we could drop that. U-Boot SPL 2021.07-rc4-00164-gb800e19a6b (Jun 29 2021 - 10:23:30 +0800) Normal Boot upower_init: soc_id=48 upower_init: version:11.11.6 upower_init: start uPower RAM service user_upwr_rdy_callb: soc=b user_upwr_rdy_callb: RAM version:12.6 Turn on switches ok Turn on memories ok Clear DDR retention ok Poll for freq_chg_req on SIM register and change to F1 frequency. Poll for freq_chg_req on SIM register and change to F0 frequency. Poll for freq_chg_req on SIM register and change to F1 frequency. Poll for freq_chg_req on SIM register and change to F2 frequency. Poll for freq_chg_req on SIM register and change to F1 frequency. Poll for freq_chg_req on SIM register and change to F2 frequency. complete De-Skew PLL is locked and ready WDT: Not found! Trying to boot from BOOTROM image offset 0x8000, pagesize 0x200, ivt offset 0x0 Load image from 0x3a800 by ROM_API NOTICE: BL31: v2.4(release):imx_5.10.35_2.0.0_imx8ulp_er-10-gf37e59b94 NOTICE: BL31: Built : 01:56:58, Jun 29 2021 NOTICE: upower_init: start uPower RAM service NOTICE: user_upwr_rdy_callb: soc=b NOTICE: user_upwr_rdy_callb: RAM version:12.6 U-Boot 2021.07-rc4-00164-gb800e19a6b (Jun 29 2021 - 10:23:30 +0800) CPU: Freescale i.MX8ULP rev1.0 at 744 MHz Reset cause: POR Boot mode: Single boot Model: FSL i.MX8ULP EVK DRAM: 2 GiB MMC: FSL_SDHC: 0, FSL_SDHC: 2 Loading Environment from MMC... *** Warning - bad CRC, using default environment In: serial@293a0000 Out: serial@293a0000 Err: serial@293a0000 Net: Warning: ethernet@29950000 (eth0) using random MAC address - 96:35:88:62:e0:44 eth0: ethernet@29950000 Hit any key to stop autoboot: 0 Signed-off-by: Peng Fan <peng.fan@nxp.com>
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40 KiB
C
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40 KiB
C
// SPDX-License-Identifier: GPL-2.0+ OR MIT
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/*
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* Copyright 2021 NXP
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*
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* Generated code from MX8M_DDR_tool
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*
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*/
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#include <linux/kernel.h>
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#include <asm/arch/ddr.h>
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/** CTL settings **/
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struct dram_cfg_param ddr_ctl_cfg[] = {
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{ 0x2e060000, 0xb00 }, /* 0 */
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{ 0x2e060028, 0x258100 }, /* 10 */
|
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{ 0x2e06002c, 0x17702 }, /* 11 */
|
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{ 0x2e060030, 0x5 }, /* 12 */
|
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{ 0x2e060034, 0x61 }, /* 13 */
|
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{ 0x2e060038, 0xce3f }, /* 14 */
|
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{ 0x2e06003c, 0x80e70 }, /* 15 */
|
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{ 0x2e060040, 0x5 }, /* 16 */
|
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{ 0x2e060044, 0x210 }, /* 17 */
|
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{ 0x2e060048, 0x19c7d }, /* 18 */
|
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{ 0x2e06004c, 0x101cdf }, /* 19 */
|
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{ 0x2e060050, 0x5 }, /* 20 */
|
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{ 0x2e060054, 0x420 }, /* 21 */
|
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{ 0x2e060058, 0x1010000 }, /* 22 */
|
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{ 0x2e06005c, 0x2011001 }, /* 23 */
|
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{ 0x2e060060, 0x2010000 }, /* 24 */
|
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{ 0x2e060064, 0x102 }, /* 25 */
|
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{ 0x2e060068, 0xa }, /* 26 */
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{ 0x2e06006c, 0x19 }, /* 27 */
|
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{ 0x2e060078, 0x2020200 }, /* 30 */
|
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{ 0x2e06007c, 0x160b }, /* 31 */
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{ 0x2e060090, 0x10 }, /* 36 */
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{ 0x2e0600a4, 0x40c040c }, /* 41 */
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{ 0x2e0600a8, 0x8040614 }, /* 42 */
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{ 0x2e0600ac, 0x604 }, /* 43 */
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{ 0x2e0600b0, 0x3090003 }, /* 44 */
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{ 0x2e0600b4, 0x40002 }, /* 45 */
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{ 0x2e0600b8, 0xc0011 }, /* 46 */
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{ 0x2e0600bc, 0xb0509 }, /* 47 */
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{ 0x2e0600c0, 0x2106 }, /* 48 */
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{ 0x2e0600c4, 0xa090017 }, /* 49 */
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{ 0x2e0600c8, 0x8200016 }, /* 50 */
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{ 0x2e0600cc, 0xa0a }, /* 51 */
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{ 0x2e0600d0, 0x4000694 }, /* 52 */
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{ 0x2e0600d4, 0xa0a0804 }, /* 53 */
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{ 0x2e0600d8, 0x4002432 }, /* 54 */
|
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{ 0x2e0600dc, 0xa0a0804 }, /* 55 */
|
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{ 0x2e0600e0, 0x4004864 }, /* 56 */
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{ 0x2e0600e4, 0x2030404 }, /* 57 */
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{ 0x2e0600e8, 0x5040400 }, /* 58 */
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{ 0x2e0600ec, 0x80b0a06 }, /* 59 */
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{ 0x2e0600f0, 0x7010100 }, /* 60 */
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{ 0x2e0600f4, 0x4150b }, /* 61 */
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{ 0x2e0600fc, 0x1010000 }, /* 63 */
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{ 0x2e060100, 0x1000000 }, /* 64 */
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{ 0x2e060104, 0xe0403 }, /* 65 */
|
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{ 0x2e060108, 0xb3 }, /* 66 */
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{ 0x2e06010c, 0x4a }, /* 67 */
|
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{ 0x2e060110, 0x3fd }, /* 68 */
|
|
{ 0x2e060114, 0x94 }, /* 69 */
|
|
{ 0x2e060118, 0x803 }, /* 70 */
|
|
{ 0x2e06011c, 0x5 }, /* 71 */
|
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{ 0x2e060120, 0x70000 }, /* 72 */
|
|
{ 0x2e060124, 0x25000f }, /* 73 */
|
|
{ 0x2e060128, 0x4a0078 }, /* 74 */
|
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{ 0x2e06012c, 0x4000f9 }, /* 75 */
|
|
{ 0x2e060130, 0x120103 }, /* 76 */
|
|
{ 0x2e060134, 0x50005 }, /* 77 */
|
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{ 0x2e060138, 0x8070005 }, /* 78 */
|
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{ 0x2e06013c, 0x505010d }, /* 79 */
|
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{ 0x2e060140, 0x101030a }, /* 80 */
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{ 0x2e060144, 0x30a0505 }, /* 81 */
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{ 0x2e060148, 0x5050101 }, /* 82 */
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|
{ 0x2e06014c, 0x1030a }, /* 83 */
|
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{ 0x2e060150, 0xe000e }, /* 84 */
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{ 0x2e060154, 0x4c004c }, /* 85 */
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{ 0x2e060158, 0x980098 }, /* 86 */
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{ 0x2e06015c, 0x3050505 }, /* 87 */
|
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{ 0x2e060160, 0x3010403 }, /* 88 */
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{ 0x2e060164, 0x4050505 }, /* 89 */
|
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{ 0x2e060168, 0x3010403 }, /* 90 */
|
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{ 0x2e06016c, 0x8050505 }, /* 91 */
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{ 0x2e060170, 0x3010403 }, /* 92 */
|
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{ 0x2e060174, 0x3010000 }, /* 93 */
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{ 0x2e060178, 0x10000 }, /* 94 */
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{ 0x2e060180, 0x1000000 }, /* 96 */
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{ 0x2e060184, 0x80104002 }, /* 97 */
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{ 0x2e0602b0, 0xd }, /* 172 */
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{ 0x2e060304, 0x19444444 }, /* 193 */
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{ 0x2e060308, 0x19081919 }, /* 194 */
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{ 0x2e06030c, 0x1919 }, /* 195 */
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{ 0x2e060310, 0x4040400 }, /* 196 */
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{ 0x2e060314, 0x1010120 }, /* 197 */
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{ 0x2e060318, 0x1000100 }, /* 198 */
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{ 0x2e06031c, 0x1 }, /* 199 */
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{ 0x2e060324, 0x1000000 }, /* 201 */
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{ 0x2e060328, 0x1 }, /* 202 */
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{ 0x2e060354, 0x11000000 }, /* 213 */
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{ 0x2e060358, 0x40c1815 }, /* 214 */
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{ 0x2e060390, 0x30000 }, /* 228 */
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{ 0x2e060394, 0x1000200 }, /* 229 */
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{ 0x2e060398, 0x310040 }, /* 230 */
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{ 0x2e06039c, 0x20002 }, /* 231 */
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{ 0x2e0603a0, 0x400100 }, /* 232 */
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{ 0x2e0603a4, 0x80108 }, /* 233 */
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{ 0x2e0603a8, 0x1000200 }, /* 234 */
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{ 0x2e0603ac, 0x2100040 }, /* 235 */
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{ 0x2e0603b0, 0x10 }, /* 236 */
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{ 0x2e0603b4, 0xe0003 }, /* 237 */
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{ 0x2e0603b8, 0x100001b }, /* 238 */
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{ 0x2e0603d8, 0xffff0b00 }, /* 246 */
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{ 0x2e0603dc, 0x1010001 }, /* 247 */
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{ 0x2e0603e0, 0x1010101 }, /* 248 */
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{ 0x2e0603e4, 0x10b0101 }, /* 249 */
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{ 0x2e0603e8, 0x10000 }, /* 250 */
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{ 0x2e0603ec, 0x4010101 }, /* 251 */
|
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{ 0x2e0603f0, 0x1010000 }, /* 252 */
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{ 0x2e0603f4, 0x4 }, /* 253 */
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{ 0x2e0603fc, 0x3030101 }, /* 255 */
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{ 0x2e060400, 0x103 }, /* 256 */
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{ 0x2e0604a4, 0x2020101 }, /* 297 */
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{ 0x2e0604a8, 0x10100 }, /* 298 */
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{ 0x2e0604ac, 0x1000101 }, /* 299 */
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{ 0x2e0604b0, 0x1010101 }, /* 300 */
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{ 0x2e0604b4, 0x4030300 }, /* 301 */
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{ 0x2e0604b8, 0x8080505 }, /* 302 */
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{ 0x2e0604bc, 0x8020808 }, /* 303 */
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{ 0x2e0604c0, 0x8020e00 }, /* 304 */
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{ 0x2e0604c4, 0xa020e00 }, /* 305 */
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{ 0x2e0604c8, 0x8000f00 }, /* 306 */
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{ 0x2e0604cc, 0xa08 }, /* 307 */
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{ 0x2e0604d0, 0x1010101 }, /* 308 */
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{ 0x2e0604e0, 0x4040000 }, /* 312 */
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{ 0x2e0604e4, 0x4000000 }, /* 313 */
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/** PI settings **/
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struct dram_cfg_param ddr_pi_cfg[] = {
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{ 0x2e06203c, 0x1 }, /* 15 */
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{ 0x2e062040, 0x5 }, /* 16 */
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{ 0x2e062064, 0x1000000 }, /* 25 */
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{ 0x2e062068, 0xa000001 }, /* 26 */
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{ 0x2e06206c, 0x28 }, /* 27 */
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{ 0x2e062070, 0x1 }, /* 28 */
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{ 0x2e062074, 0x320005 }, /* 29 */
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{ 0x2e06248c, 0x44300914 }, /* 291 */
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{ 0x2e062494, 0x19443000 }, /* 293 */
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{ 0x2e062498, 0x40419 }, /* 294 */
|
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{ 0x2e06249c, 0x19194430 }, /* 295 */
|
|
{ 0x2e0624a0, 0x30091404 }, /* 296 */
|
|
{ 0x2e0624a4, 0x4191944 }, /* 297 */
|
|
};
|
|
|
|
/** PHY_F1 settings **/
|
|
struct dram_cfg_param ddr_phy_f1_cfg[] = {
|
|
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|
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{ 0x2e064014, 0x3000000 }, /* 5 */
|
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{ 0x2e064018, 0x1000001 }, /* 6 */
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{ 0x2e06401c, 0x3000400 }, /* 7 */
|
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{ 0x2e064020, 0x1 }, /* 8 */
|
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{ 0x2e064024, 0x1 }, /* 9 */
|
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{ 0x2e064030, 0x10000 }, /* 12 */
|
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{ 0x2e064038, 0xc00004 }, /* 14 */
|
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{ 0x2e06403c, 0xcc0008 }, /* 15 */
|
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{ 0x2e064040, 0x660601 }, /* 16 */
|
|
{ 0x2e064044, 0x3 }, /* 17 */
|
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{ 0x2e06404c, 0x1 }, /* 19 */
|
|
{ 0x2e064050, 0xaaaa }, /* 20 */
|
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{ 0x2e064054, 0x5555 }, /* 21 */
|
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{ 0x2e064058, 0xb5b5 }, /* 22 */
|
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{ 0x2e06405c, 0x4a4a }, /* 23 */
|
|
{ 0x2e064060, 0x5656 }, /* 24 */
|
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{ 0x2e064064, 0xa9a9 }, /* 25 */
|
|
{ 0x2e064068, 0xb7b7 }, /* 26 */
|
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{ 0x2e06406c, 0x4848 }, /* 27 */
|
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{ 0x2e064078, 0x8000000 }, /* 30 */
|
|
{ 0x2e06407c, 0x4010008 }, /* 31 */
|
|
{ 0x2e064080, 0x408 }, /* 32 */
|
|
{ 0x2e064084, 0x3102000 }, /* 33 */
|
|
{ 0x2e064088, 0xc0020 }, /* 34 */
|
|
{ 0x2e06408c, 0x10000 }, /* 35 */
|
|
{ 0x2e064090, 0x55555555 }, /* 36 */
|
|
{ 0x2e064094, 0xaaaaaaaa }, /* 37 */
|
|
{ 0x2e064098, 0x55555555 }, /* 38 */
|
|
{ 0x2e06409c, 0xaaaaaaaa }, /* 39 */
|
|
{ 0x2e0640a0, 0x5555 }, /* 40 */
|
|
{ 0x2e0640a4, 0x1000100 }, /* 41 */
|
|
{ 0x2e0640a8, 0x800180 }, /* 42 */
|
|
{ 0x2e0640ac, 0x1 }, /* 43 */
|
|
{ 0x2e064100, 0x4 }, /* 64 */
|
|
{ 0x2e06411c, 0x41f07ff }, /* 71 */
|
|
{ 0x2e064120, 0x1 }, /* 72 */
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{ 0x2e064d1c, 0x41f07ff }, /* 839 */
|
|
{ 0x2e064d20, 0x1 }, /* 840 */
|
|
{ 0x2e064d24, 0x1cc0800 }, /* 841 */
|
|
{ 0x2e064d28, 0x3003cc08 }, /* 842 */
|
|
{ 0x2e064d2c, 0x2000014e }, /* 843 */
|
|
{ 0x2e064d30, 0x7ff0200 }, /* 844 */
|
|
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|
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|
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|
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|
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|
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{ 0x2e064d8c, 0x8 }, /* 867 */
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{ 0x2e064d90, 0x2c302c3 }, /* 868 */
|
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|
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|
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{ 0x2e064d9c, 0x2c302c3 }, /* 871 */
|
|
{ 0x2e064da0, 0x2c3 }, /* 872 */
|
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|
|
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|
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{ 0x2e064dac, 0x800080 }, /* 875 */
|
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|
|
{ 0x2e064db4, 0x800080 }, /* 877 */
|
|
{ 0x2e064db8, 0x800080 }, /* 878 */
|
|
{ 0x2e064dbc, 0x800080 }, /* 879 */
|
|
{ 0x2e064dc0, 0x800080 }, /* 880 */
|
|
{ 0x2e064dc4, 0x800080 }, /* 881 */
|
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{ 0x2e064dc8, 0x6b0080 }, /* 882 */
|
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{ 0x2e064dcc, 0x1a00001 }, /* 883 */
|
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|
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|
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{ 0x2e065014, 0x100 }, /* 1029 */
|
|
{ 0x2e065018, 0x201 }, /* 1030 */
|
|
{ 0x2e06502c, 0x400000 }, /* 1035 */
|
|
{ 0x2e065030, 0x80 }, /* 1036 */
|
|
{ 0x2e065034, 0xdcba98 }, /* 1037 */
|
|
{ 0x2e065038, 0x3000000 }, /* 1038 */
|
|
{ 0x2e06504c, 0x2a }, /* 1043 */
|
|
{ 0x2e065050, 0x15 }, /* 1044 */
|
|
{ 0x2e065054, 0x15 }, /* 1045 */
|
|
{ 0x2e065058, 0x2a }, /* 1046 */
|
|
{ 0x2e06505c, 0x33 }, /* 1047 */
|
|
{ 0x2e065060, 0xc }, /* 1048 */
|
|
{ 0x2e065064, 0xc }, /* 1049 */
|
|
{ 0x2e065068, 0x33 }, /* 1050 */
|
|
{ 0x2e06506c, 0x543210 }, /* 1051 */
|
|
{ 0x2e065070, 0x3f0000 }, /* 1052 */
|
|
{ 0x2e065074, 0xf013f }, /* 1053 */
|
|
{ 0x2e065078, 0xf }, /* 1054 */
|
|
{ 0x2e06507c, 0x3cc }, /* 1055 */
|
|
{ 0x2e065080, 0x30000 }, /* 1056 */
|
|
{ 0x2e065084, 0x300 }, /* 1057 */
|
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|
|
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|
|
{ 0x2e065090, 0x300 }, /* 1060 */
|
|
{ 0x2e065094, 0x300 }, /* 1061 */
|
|
{ 0x2e065098, 0x42080010 }, /* 1062 */
|
|
{ 0x2e06509c, 0x332 }, /* 1063 */
|
|
{ 0x2e0650a0, 0x2 }, /* 1064 */
|
|
{ 0x2e065414, 0x100 }, /* 1285 */
|
|
{ 0x2e065418, 0x201 }, /* 1286 */
|
|
{ 0x2e06542c, 0x400000 }, /* 1291 */
|
|
{ 0x2e065430, 0x80 }, /* 1292 */
|
|
{ 0x2e065434, 0xdcba98 }, /* 1293 */
|
|
{ 0x2e065438, 0x3000000 }, /* 1294 */
|
|
{ 0x2e06544c, 0x2a }, /* 1299 */
|
|
{ 0x2e065450, 0x15 }, /* 1300 */
|
|
{ 0x2e065454, 0x15 }, /* 1301 */
|
|
{ 0x2e065458, 0x2a }, /* 1302 */
|
|
{ 0x2e06545c, 0x33 }, /* 1303 */
|
|
{ 0x2e065460, 0xc }, /* 1304 */
|
|
{ 0x2e065464, 0xc }, /* 1305 */
|
|
{ 0x2e065468, 0x33 }, /* 1306 */
|
|
{ 0x2e06546c, 0x543210 }, /* 1307 */
|
|
{ 0x2e065470, 0x3f0000 }, /* 1308 */
|
|
{ 0x2e065474, 0xf013f }, /* 1309 */
|
|
{ 0x2e065478, 0xf }, /* 1310 */
|
|
{ 0x2e06547c, 0x3cc }, /* 1311 */
|
|
{ 0x2e065480, 0x30000 }, /* 1312 */
|
|
{ 0x2e065484, 0x300 }, /* 1313 */
|
|
{ 0x2e065488, 0x300 }, /* 1314 */
|
|
{ 0x2e06548c, 0x300 }, /* 1315 */
|
|
{ 0x2e065490, 0x300 }, /* 1316 */
|
|
{ 0x2e065494, 0x300 }, /* 1317 */
|
|
{ 0x2e065498, 0x42080010 }, /* 1318 */
|
|
{ 0x2e06549c, 0x332 }, /* 1319 */
|
|
{ 0x2e0654a0, 0x2 }, /* 1320 */
|
|
{ 0x2e065804, 0x100 }, /* 1537 */
|
|
{ 0x2e065814, 0x50000 }, /* 1541 */
|
|
{ 0x2e065818, 0x4000100 }, /* 1542 */
|
|
{ 0x2e06581c, 0x55 }, /* 1543 */
|
|
{ 0x2e06582c, 0xf0001 }, /* 1547 */
|
|
{ 0x2e065830, 0x280040 }, /* 1548 */
|
|
{ 0x2e065834, 0x5002 }, /* 1549 */
|
|
{ 0x2e065838, 0x10101 }, /* 1550 */
|
|
{ 0x2e065840, 0x90e0000 }, /* 1552 */
|
|
{ 0x2e065844, 0x101010f }, /* 1553 */
|
|
{ 0x2e065848, 0x10f0004 }, /* 1554 */
|
|
{ 0x2e065854, 0x64 }, /* 1557 */
|
|
{ 0x2e06585c, 0x1000000 }, /* 1559 */
|
|
{ 0x2e065860, 0x8040201 }, /* 1560 */
|
|
{ 0x2e065864, 0x2010201 }, /* 1561 */
|
|
{ 0x2e065868, 0xf0f0f }, /* 1562 */
|
|
{ 0x2e06586c, 0x241b42 }, /* 1563 */
|
|
{ 0x2e065874, 0x1020000 }, /* 1565 */
|
|
{ 0x2e065878, 0x701 }, /* 1566 */
|
|
{ 0x2e06587c, 0x54 }, /* 1567 */
|
|
{ 0x2e065880, 0x4102000 }, /* 1568 */
|
|
{ 0x2e065884, 0x24410 }, /* 1569 */
|
|
{ 0x2e065888, 0x4410 }, /* 1570 */
|
|
{ 0x2e06588c, 0x4410 }, /* 1571 */
|
|
{ 0x2e065890, 0x4410 }, /* 1572 */
|
|
{ 0x2e065894, 0x4410 }, /* 1573 */
|
|
{ 0x2e065898, 0x4410 }, /* 1574 */
|
|
{ 0x2e06589c, 0x4410 }, /* 1575 */
|
|
{ 0x2e0658a0, 0x4410 }, /* 1576 */
|
|
{ 0x2e0658a4, 0x4410 }, /* 1577 */
|
|
{ 0x2e0658b0, 0x60000 }, /* 1580 */
|
|
{ 0x2e0658b8, 0x96 }, /* 1582 */
|
|
{ 0x2e0658bc, 0x10000 }, /* 1583 */
|
|
{ 0x2e0658c0, 0x8 }, /* 1584 */
|
|
{ 0x2e0658d8, 0x3000000 }, /* 1590 */
|
|
{ 0x2e0658e8, 0x4102006 }, /* 1594 */
|
|
{ 0x2e0658ec, 0x41020 }, /* 1595 */
|
|
{ 0x2e0658f0, 0x1c98c98 }, /* 1596 */
|
|
{ 0x2e0658f4, 0x3f400000 }, /* 1597 */
|
|
{ 0x2e0658f8, 0x3f3f1f3f }, /* 1598 */
|
|
{ 0x2e0658fc, 0x1f }, /* 1599 */
|
|
{ 0x2e06590c, 0x1 }, /* 1603 */
|
|
{ 0x2e06591c, 0x1 }, /* 1607 */
|
|
{ 0x2e065920, 0x76543210 }, /* 1608 */
|
|
{ 0x2e065924, 0x10198 }, /* 1609 */
|
|
{ 0x2e065934, 0x40700 }, /* 1613 */
|
|
{ 0x2e06594c, 0x2 }, /* 1619 */
|
|
{ 0x2e065958, 0xf3c3 }, /* 1622 */
|
|
{ 0x2e065964, 0x11542 }, /* 1625 */
|
|
{ 0x2e065968, 0x30209bf }, /* 1626 */
|
|
{ 0x2e06596c, 0x30000 }, /* 1627 */
|
|
{ 0x2e065970, 0x3000300 }, /* 1628 */
|
|
{ 0x2e065974, 0x3000300 }, /* 1629 */
|
|
{ 0x2e065978, 0x3000300 }, /* 1630 */
|
|
{ 0x2e06597c, 0x3000300 }, /* 1631 */
|
|
{ 0x2e065980, 0x300 }, /* 1632 */
|
|
{ 0x2e065984, 0x300 }, /* 1633 */
|
|
{ 0x2e065988, 0x300 }, /* 1634 */
|
|
{ 0x2e06598c, 0x4bf77 }, /* 1635 */
|
|
{ 0x2e065990, 0x77 }, /* 1636 */
|
|
{ 0x2e065994, 0x27f }, /* 1637 */
|
|
{ 0x2e06599c, 0x27f }, /* 1639 */
|
|
{ 0x2e0659a4, 0x27f00 }, /* 1641 */
|
|
{ 0x2e0659a8, 0x1980000 }, /* 1642 */
|
|
{ 0x2e0659ac, 0x27fcc }, /* 1643 */
|
|
{ 0x2e0659b4, 0x27f00 }, /* 1645 */
|
|
{ 0x2e0659b8, 0x1980000 }, /* 1646 */
|
|
{ 0x2e0659bc, 0x27f00 }, /* 1647 */
|
|
{ 0x2e0659c0, 0x1980000 }, /* 1648 */
|
|
{ 0x2e0659c4, 0x27f00 }, /* 1649 */
|
|
{ 0x2e0659c8, 0x1980000 }, /* 1650 */
|
|
{ 0x2e0659cc, 0x27f00 }, /* 1651 */
|
|
{ 0x2e0659d0, 0x1980000 }, /* 1652 */
|
|
{ 0x2e0659d4, 0x20040003 }, /* 1653 */
|
|
};
|
|
|
|
/** PHY_F2 settings **/
|
|
struct dram_cfg_param ddr_phy_f2_cfg[] = {
|
|
{ 0x2e064168, 0x3020000 }, /* 90 */
|
|
{ 0x2e064170, 0xc043e42 }, /* 92 */
|
|
{ 0x2e064174, 0xf0c1701 }, /* 93 */
|
|
{ 0x2e064180, 0x187 }, /* 96 */
|
|
{ 0x2e064184, 0x3010203 }, /* 97 */
|
|
{ 0x2e064190, 0x3070307 }, /* 100 */
|
|
{ 0x2e064194, 0x3070307 }, /* 101 */
|
|
{ 0x2e064198, 0x3070307 }, /* 102 */
|
|
{ 0x2e06419c, 0x3070307 }, /* 103 */
|
|
{ 0x2e0641a0, 0x307 }, /* 104 */
|
|
{ 0x2e0641c8, 0x1bd0080 }, /* 114 */
|
|
{ 0x2e064568, 0x3020000 }, /* 346 */
|
|
{ 0x2e064570, 0xc043e42 }, /* 348 */
|
|
{ 0x2e064574, 0xf0c1701 }, /* 349 */
|
|
{ 0x2e064580, 0x187 }, /* 352 */
|
|
{ 0x2e064584, 0x3010203 }, /* 353 */
|
|
{ 0x2e064590, 0x3070307 }, /* 356 */
|
|
{ 0x2e064594, 0x3070307 }, /* 357 */
|
|
{ 0x2e064598, 0x3070307 }, /* 358 */
|
|
{ 0x2e06459c, 0x3070307 }, /* 359 */
|
|
{ 0x2e0645a0, 0x307 }, /* 360 */
|
|
{ 0x2e0645c8, 0x1bd0080 }, /* 370 */
|
|
{ 0x2e064968, 0x3020000 }, /* 602 */
|
|
{ 0x2e064970, 0xc043e42 }, /* 604 */
|
|
{ 0x2e064974, 0xf0c1701 }, /* 605 */
|
|
{ 0x2e064980, 0x187 }, /* 608 */
|
|
{ 0x2e064984, 0x3010203 }, /* 609 */
|
|
{ 0x2e064990, 0x3070307 }, /* 612 */
|
|
{ 0x2e064994, 0x3070307 }, /* 613 */
|
|
{ 0x2e064998, 0x3070307 }, /* 614 */
|
|
{ 0x2e06499c, 0x3070307 }, /* 615 */
|
|
{ 0x2e0649a0, 0x307 }, /* 616 */
|
|
{ 0x2e0649c8, 0x1bd0080 }, /* 626 */
|
|
{ 0x2e064d68, 0x3020000 }, /* 858 */
|
|
{ 0x2e064d70, 0xc043e42 }, /* 860 */
|
|
{ 0x2e064d74, 0xf0c1701 }, /* 861 */
|
|
{ 0x2e064d80, 0x187 }, /* 864 */
|
|
{ 0x2e064d84, 0x3010203 }, /* 865 */
|
|
{ 0x2e064d90, 0x3070307 }, /* 868 */
|
|
{ 0x2e064d94, 0x3070307 }, /* 869 */
|
|
{ 0x2e064d98, 0x3070307 }, /* 870 */
|
|
{ 0x2e064d9c, 0x3070307 }, /* 871 */
|
|
{ 0x2e064da0, 0x307 }, /* 872 */
|
|
{ 0x2e064dc8, 0x1bd0080 }, /* 882 */
|
|
{ 0x2e06509c, 0x33e }, /* 1063 */
|
|
{ 0x2e06549c, 0x33e }, /* 1319 */
|
|
{ 0x2e065878, 0x10703 }, /* 1566 */
|
|
{ 0x2e065964, 0x1342 }, /* 1625 */
|
|
};
|
|
|
|
/* ddr timing config params */
|
|
struct dram_timing_info2 dram_timing = {
|
|
.ctl_cfg = ddr_ctl_cfg,
|
|
.ctl_cfg_num = ARRAY_SIZE(ddr_ctl_cfg),
|
|
.pi_cfg = ddr_pi_cfg,
|
|
.pi_cfg_num = ARRAY_SIZE(ddr_pi_cfg),
|
|
.phy_f1_cfg = ddr_phy_f1_cfg,
|
|
.phy_f1_cfg_num = ARRAY_SIZE(ddr_phy_f1_cfg),
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.phy_f2_cfg = ddr_phy_f2_cfg,
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.phy_f2_cfg_num = ARRAY_SIZE(ddr_phy_f2_cfg),
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.fsp_table = { 96, 528, 1056 },
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