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Enable the Chrome OS EC so that it can be used from U-Boot. Signed-off-by: Simon Glass <sjg@chromium.org>
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C
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C
/*
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* Copyright (C) 2014 Google, Inc
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* SPDX-License-Identifier: GPL-2.0+
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*/
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#include <common.h>
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#include <cros_ec.h>
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#include <asm/gpio.h>
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int arch_early_init_r(void)
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{
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if (cros_ec_board_init())
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return -1;
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return 0;
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}
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static const struct pch_gpio_set1 pch_gpio_set1_mode = {
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.gpio0 = GPIO_MODE_GPIO, /* NMI_DBG# */
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.gpio3 = GPIO_MODE_GPIO, /* ALS_INT# */
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.gpio5 = GPIO_MODE_GPIO, /* SIM_DET */
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.gpio7 = GPIO_MODE_GPIO, /* EC_SCI# */
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.gpio8 = GPIO_MODE_GPIO, /* EC_SMI# */
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.gpio9 = GPIO_MODE_GPIO, /* RECOVERY# */
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.gpio10 = GPIO_MODE_GPIO, /* SPD vector D3 */
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.gpio11 = GPIO_MODE_GPIO, /* smbalert#, let's keep it initialized */
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.gpio12 = GPIO_MODE_GPIO, /* TP_INT# */
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.gpio14 = GPIO_MODE_GPIO, /* Touch_INT_L */
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.gpio15 = GPIO_MODE_GPIO, /* EC_LID_OUT# (EC_WAKE#) */
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|
.gpio21 = GPIO_MODE_GPIO, /* EC_IN_RW */
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.gpio24 = GPIO_MODE_GPIO, /* DDR3L_EN */
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|
.gpio28 = GPIO_MODE_GPIO, /* SLP_ME_CSW_DEV# */
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};
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static const struct pch_gpio_set1 pch_gpio_set1_direction = {
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.gpio0 = GPIO_DIR_INPUT,
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.gpio3 = GPIO_DIR_INPUT,
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|
.gpio5 = GPIO_DIR_INPUT,
|
|
.gpio7 = GPIO_DIR_INPUT,
|
|
.gpio8 = GPIO_DIR_INPUT,
|
|
.gpio9 = GPIO_DIR_INPUT,
|
|
.gpio10 = GPIO_DIR_INPUT,
|
|
.gpio11 = GPIO_DIR_INPUT,
|
|
.gpio12 = GPIO_DIR_INPUT,
|
|
.gpio14 = GPIO_DIR_INPUT,
|
|
.gpio15 = GPIO_DIR_INPUT,
|
|
.gpio21 = GPIO_DIR_INPUT,
|
|
.gpio24 = GPIO_DIR_OUTPUT,
|
|
.gpio28 = GPIO_DIR_INPUT,
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|
};
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static const struct pch_gpio_set1 pch_gpio_set1_level = {
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.gpio1 = GPIO_LEVEL_HIGH,
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.gpio6 = GPIO_LEVEL_HIGH,
|
|
.gpio24 = GPIO_LEVEL_LOW,
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|
};
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static const struct pch_gpio_set1 pch_gpio_set1_invert = {
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.gpio7 = GPIO_INVERT,
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.gpio8 = GPIO_INVERT,
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|
.gpio12 = GPIO_INVERT,
|
|
.gpio14 = GPIO_INVERT,
|
|
.gpio15 = GPIO_INVERT,
|
|
};
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|
static const struct pch_gpio_set2 pch_gpio_set2_mode = {
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|
.gpio36 = GPIO_MODE_GPIO, /* W_DISABLE_L */
|
|
.gpio41 = GPIO_MODE_GPIO, /* SPD vector D0 */
|
|
.gpio42 = GPIO_MODE_GPIO, /* SPD vector D1 */
|
|
.gpio43 = GPIO_MODE_GPIO, /* SPD vector D2 */
|
|
.gpio57 = GPIO_MODE_GPIO, /* PCH_SPI_WP_D */
|
|
.gpio60 = GPIO_MODE_GPIO, /* DRAMRST_CNTRL_PCH */
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|
};
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static const struct pch_gpio_set2 pch_gpio_set2_direction = {
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|
.gpio36 = GPIO_DIR_OUTPUT,
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|
.gpio41 = GPIO_DIR_INPUT,
|
|
.gpio42 = GPIO_DIR_INPUT,
|
|
.gpio43 = GPIO_DIR_INPUT,
|
|
.gpio57 = GPIO_DIR_INPUT,
|
|
.gpio60 = GPIO_DIR_OUTPUT,
|
|
};
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|
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static const struct pch_gpio_set2 pch_gpio_set2_level = {
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|
.gpio36 = GPIO_LEVEL_HIGH,
|
|
.gpio60 = GPIO_LEVEL_HIGH,
|
|
};
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static const struct pch_gpio_set3 pch_gpio_set3_mode = {
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|
};
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static const struct pch_gpio_set3 pch_gpio_set3_direction = {
|
|
};
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static const struct pch_gpio_set3 pch_gpio_set3_level = {
|
|
};
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static const struct pch_gpio_map link_gpio_map = {
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.set1 = {
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.mode = &pch_gpio_set1_mode,
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|
.direction = &pch_gpio_set1_direction,
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|
.level = &pch_gpio_set1_level,
|
|
.invert = &pch_gpio_set1_invert,
|
|
},
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|
.set2 = {
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|
.mode = &pch_gpio_set2_mode,
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|
.direction = &pch_gpio_set2_direction,
|
|
.level = &pch_gpio_set2_level,
|
|
},
|
|
.set3 = {
|
|
.mode = &pch_gpio_set3_mode,
|
|
.direction = &pch_gpio_set3_direction,
|
|
.level = &pch_gpio_set3_level,
|
|
},
|
|
};
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int board_early_init_f(void)
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|
{
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ich_gpio_set_gpio_map(&link_gpio_map);
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return 0;
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|
}
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