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u-boot/drivers/ram/k3-j721e/lpddr4_ctl_regs.h
Kevin Scholz 3bb3f266ee ram: k3-j721e: Add support for J721E DDR controller 
The J721E DDR subsystem comprises DDR controller, DDR PHY and wrapper
logic to integrate these blocks in the device. The DDR subsystem is
used to provide an interface to external SDRAM devices which can be
utilized for storing program or data. Introduce support for the
DDR controller and DDR phy within the DDR subsystem.

Signed-off-by: Kevin Scholz <k-scholz@ti.com
Signed-off-by: Lokesh Vutla <lokeshvutla@ti.com>
2019-10-25 17:33:21 -04:00

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/**********************************************************************
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*
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*
**********************************************************************
*/
#ifndef REG_LPDDR4_CTL_REGS_H_
#define REG_LPDDR4_CTL_REGS_H_
#include "lpddr4_ddr_controller_macros.h"
#include "lpddr4_pi_macros.h"
#include "lpddr4_data_slice_0_macros.h"
#include "lpddr4_data_slice_1_macros.h"
#include "lpddr4_data_slice_2_macros.h"
#include "lpddr4_data_slice_3_macros.h"
#include "lpddr4_address_slice_0_macros.h"
#include "lpddr4_phy_core_macros.h"
typedef struct __attribute__((packed)) lpddr4_ctlregs_s {
volatile uint32_t DENALI_CTL_0;
volatile uint32_t DENALI_CTL_1;
volatile uint32_t DENALI_CTL_2;
volatile uint32_t DENALI_CTL_3;
volatile uint32_t DENALI_CTL_4;
volatile uint32_t DENALI_CTL_5;
volatile uint32_t DENALI_CTL_6;
volatile uint32_t DENALI_CTL_7;
volatile uint32_t DENALI_CTL_8;
volatile uint32_t DENALI_CTL_9;
volatile uint32_t DENALI_CTL_10;
volatile uint32_t DENALI_CTL_11;
volatile uint32_t DENALI_CTL_12;
volatile uint32_t DENALI_CTL_13;
volatile uint32_t DENALI_CTL_14;
volatile uint32_t DENALI_CTL_15;
volatile uint32_t DENALI_CTL_16;
volatile uint32_t DENALI_CTL_17;
volatile uint32_t DENALI_CTL_18;
volatile uint32_t DENALI_CTL_19;
volatile uint32_t DENALI_CTL_20;
volatile uint32_t DENALI_CTL_21;
volatile uint32_t DENALI_CTL_22;
volatile uint32_t DENALI_CTL_23;
volatile uint32_t DENALI_CTL_24;
volatile uint32_t DENALI_CTL_25;
volatile uint32_t DENALI_CTL_26;
volatile uint32_t DENALI_CTL_27;
volatile uint32_t DENALI_CTL_28;
volatile uint32_t DENALI_CTL_29;
volatile uint32_t DENALI_CTL_30;
volatile uint32_t DENALI_CTL_31;
volatile uint32_t DENALI_CTL_32;
volatile uint32_t DENALI_CTL_33;
volatile uint32_t DENALI_CTL_34;
volatile uint32_t DENALI_CTL_35;
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volatile uint32_t DENALI_CTL_37;
volatile uint32_t DENALI_CTL_38;
volatile uint32_t DENALI_CTL_39;
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volatile uint32_t DENALI_CTL_50;
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volatile uint32_t DENALI_CTL_128;
volatile uint32_t DENALI_CTL_129;
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volatile uint32_t DENALI_CTL_154;
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volatile uint32_t DENALI_CTL_158;
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volatile uint32_t DENALI_CTL_171;
volatile uint32_t DENALI_CTL_172;
volatile uint32_t DENALI_CTL_173;
volatile uint32_t DENALI_CTL_174;
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volatile uint32_t DENALI_CTL_347;
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volatile uint32_t DENALI_CTL_367;
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volatile uint32_t DENALI_CTL_451;
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#endif /* REG_LPDDR4_CTL_REGS_H_ */
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