Mirrors/u-boot
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u-boot/drivers/ram/rockchip/sdram-rk3399-lpddr4-800.inc
Jagan Teki dd2c633b2a ram: rk3399: Add LPPDDR4-800 timings inc 
LPDDR4 initialization start with at board selected frequency
and then it switches into 400MHz and 800MHz simultaneously to
make the proper sequence work on each channel with associated
training.

So, add LPDDR4-800 timings inc file in driver area so-that
these timings will take during LPDDR4 initialization phase.

Signed-off-by: Jagan Teki <jagan@amarulasolutions.com>
Signed-off-by: YouMin Chen <cym@rock-chips.com>
Reviewed-by: Kever Yang <Kever.yang@rock-chips.com>
2019-07-21 00:00:30 +08:00

1570 lines
60 KiB
SQL
Raw Blame History

// SPDX-License-Identifier: GPL-2.0
/*
* (C) Copyright 2019 Rockchip Electronics Co., Ltd.
* (C) Copyright 2019 Amarula Solutions
*/
{
{
{
{
.rank = 0x2,
.col = 0xA,
.bk = 0x3,
.bw = 0x2,
.dbw = 0x1,
.row_3_4 = 0x0,
.cs0_row = 0xF,
.cs1_row = 0xF,
.ddrconfig = 1,
},
{
.ddrtiminga0 = 0x80241d22,
.ddrtimingb0 = 0x15050f08,
.ddrtimingc0 = {
0x00000602,
},
.devtodev0 = 0x00002122,
.ddrmode = {
0x0000004c,
},
.agingx0 = 0x00000000,
}
},
{
{
.rank = 0x2,
.col = 0xA,
.bk = 0x3,
.bw = 0x2,
.dbw = 0x1,
.row_3_4 = 0x0,
.cs0_row = 0xF,
.cs1_row = 0xF,
.ddrconfig = 1,
},
{
.ddrtiminga0 = 0x80241d22,
.ddrtimingb0 = 0x15050f08,
.ddrtimingc0 = {
0x00000602,
},
.devtodev0 = 0x00002122,
.ddrmode = {
0x0000004c,
},
.agingx0 = 0x00000000,
}
}
},
{
.ddr_freq = 800 * MHz,
.dramtype = LPDDR4,
.num_channels = 2,
.stride = 13,
.odt = 1,
},
{
{
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0x00000005, /* DENALI_CTL_15_DATA */
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