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https://github.com/AsahiLinux/u-boot
synced 2024-11-11 23:47:24 +00:00
arm: Drop old kona code
The KONA and KONA_GPIO options don't exist anymore, since this commit:
0f6807e77b arm: Remove bcm28155_ap board
Drop the dead code.
Signed-off-by: Simon Glass <sjg@chromium.org>
This commit is contained in:
Simon Glass
Tom Rini
parent
c4b25d5908
commit
8742abedcf
8 changed files with 0 additions and 229 deletions
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@ -26,7 +26,6 @@ obj-$(CONFIG_ARMV7_NONSEC) += nonsec_virt.o virt-v7.o virt-dt.o
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obj-$(CONFIG_ARMV7_PSCI) += psci.o psci-common.o
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obj-$(CONFIG_IPROC) += iproc-common/
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obj-$(CONFIG_KONA) += kona-common/
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obj-$(CONFIG_SYS_ARCH_TIMER) += arch_timer.o
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ifneq (,$(filter s5pc1xx exynos,$(SOC)))
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@ -1,8 +0,0 @@
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# SPDX-License-Identifier: GPL-2.0+
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||||
#
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||||
# Copyright 2013 Broadcom Corporation.
|
||||
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||||
obj-y += s_init.o
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||||
obj-y += hwinit-common.o
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||||
obj-y += clk-stubs.o
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||||
obj-${CONFIG_KONA_RESET_S} += reset.o
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||||
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@ -1,25 +0,0 @@
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|||
// SPDX-License-Identifier: GPL-2.0+
|
||||
/*
|
||||
* Copyright 2013 Broadcom Corporation.
|
||||
*/
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||||
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||||
#include <common.h>
|
||||
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||||
/*
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||||
* These weak functions are available to kona architectures that don't
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||||
* require clock enables from the driver code.
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||||
*/
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||||
int __weak clk_sdio_enable(void *base, u32 rate, u32 *actual_ratep)
|
||||
{
|
||||
return 0;
|
||||
}
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||||
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||||
int __weak clk_bsc_enable(void *base)
|
||||
{
|
||||
return 0;
|
||||
}
|
||||
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||||
int __weak clk_usb_otg_enable(void *base)
|
||||
{
|
||||
return 0;
|
||||
}
|
||||
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|
@ -1,17 +0,0 @@
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|||
// SPDX-License-Identifier: GPL-2.0+
|
||||
/*
|
||||
* Copyright 2013 Broadcom Corporation.
|
||||
*/
|
||||
|
||||
#include <common.h>
|
||||
#include <cpu_func.h>
|
||||
#include <asm/cache.h>
|
||||
#include <linux/sizes.h>
|
||||
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||||
#if !CONFIG_IS_ENABLED(SYS_DCACHE_OFF)
|
||||
void enable_caches(void)
|
||||
{
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||||
/* Enable D-cache. I-cache is already enabled in start.S */
|
||||
dcache_enable();
|
||||
}
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||||
#endif
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||||
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|
@ -1,25 +0,0 @@
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|||
/* SPDX-License-Identifier: GPL-2.0+ */
|
||||
/*
|
||||
* Copyright 2013 Broadcom Corporation.
|
||||
*/
|
||||
|
||||
.globl reset_cpu
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||||
reset_cpu:
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||||
ldr r1, =0x35001f00
|
||||
ldr r2, [r1]
|
||||
ldr r4, =0x80000000
|
||||
and r4, r2, r4
|
||||
ldr r3, =0xA5A500
|
||||
orr r4, r4, r3
|
||||
orr r4, r4, #0x1
|
||||
|
||||
str r4, [r1]
|
||||
|
||||
ldr r1, =0x35001f04
|
||||
ldr r2, [r1]
|
||||
ldr r4, =0x80000000
|
||||
and r4, r2, r4
|
||||
str r4, [r1]
|
||||
|
||||
_loop_forever:
|
||||
b _loop_forever
|
||||
|
|
@ -1,11 +0,0 @@
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|||
// SPDX-License-Identifier: GPL-2.0+
|
||||
/*
|
||||
* Copyright 2014 Broadcom Corporation.
|
||||
*/
|
||||
|
||||
/*
|
||||
* Early system init. Currently empty.
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||||
*/
|
||||
void s_init(void)
|
||||
{
|
||||
}
|
||||
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@ -23,7 +23,6 @@ obj-$(CONFIG_INTEL_ICH6_GPIO) += intel_ich6_gpio.o
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|||
obj-$(CONFIG_INTEL_BROADWELL_GPIO) += intel_broadwell_gpio.o
|
||||
obj-$(CONFIG_IPROC_GPIO) += iproc_gpio.o
|
||||
obj-$(CONFIG_KIRKWOOD_GPIO) += kw_gpio.o
|
||||
obj-$(CONFIG_KONA_GPIO) += kona_gpio.o
|
||||
obj-$(CONFIG_MCP230XX_GPIO) += mcp230xx_gpio.o
|
||||
obj-$(CONFIG_MXC_GPIO) += mxc_gpio.o
|
||||
obj-$(CONFIG_MXS_GPIO) += mxs_gpio.o
|
||||
|
|
|
|||
|
|
@ -1,141 +0,0 @@
|
|||
// SPDX-License-Identifier: GPL-2.0+
|
||||
/*
|
||||
* Copyright 2013 Broadcom Corporation.
|
||||
*/
|
||||
|
||||
#include <common.h>
|
||||
#include <malloc.h>
|
||||
#include <asm/io.h>
|
||||
#include <asm/arch/sysmap.h>
|
||||
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||||
#define GPIO_BASE (void *)GPIO2_BASE_ADDR
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||||
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||||
#define GPIO_PASSWD 0x00a5a501
|
||||
#define GPIO_PER_BANK 32
|
||||
#define GPIO_MAX_BANK_NUM 8
|
||||
|
||||
#define GPIO_BANK(gpio) ((gpio) >> 5)
|
||||
#define GPIO_BITMASK(gpio) \
|
||||
(1UL << ((gpio) & (GPIO_PER_BANK - 1)))
|
||||
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||||
#define GPIO_OUT_STATUS(bank) (0x00000000 + ((bank) << 2))
|
||||
#define GPIO_IN_STATUS(bank) (0x00000020 + ((bank) << 2))
|
||||
#define GPIO_OUT_SET(bank) (0x00000040 + ((bank) << 2))
|
||||
#define GPIO_OUT_CLEAR(bank) (0x00000060 + ((bank) << 2))
|
||||
#define GPIO_INT_STATUS(bank) (0x00000080 + ((bank) << 2))
|
||||
#define GPIO_INT_MASK(bank) (0x000000a0 + ((bank) << 2))
|
||||
#define GPIO_INT_MSKCLR(bank) (0x000000c0 + ((bank) << 2))
|
||||
#define GPIO_CONTROL(bank) (0x00000100 + ((bank) << 2))
|
||||
#define GPIO_PWD_STATUS(bank) (0x00000500 + ((bank) << 2))
|
||||
|
||||
#define GPIO_GPPWR_OFFSET 0x00000520
|
||||
|
||||
#define GPIO_GPCTR0_DBR_SHIFT 5
|
||||
#define GPIO_GPCTR0_DBR_MASK 0x000001e0
|
||||
|
||||
#define GPIO_GPCTR0_ITR_SHIFT 3
|
||||
#define GPIO_GPCTR0_ITR_MASK 0x00000018
|
||||
#define GPIO_GPCTR0_ITR_CMD_RISING_EDGE 0x00000001
|
||||
#define GPIO_GPCTR0_ITR_CMD_FALLING_EDGE 0x00000002
|
||||
#define GPIO_GPCTR0_ITR_CMD_BOTH_EDGE 0x00000003
|
||||
|
||||
#define GPIO_GPCTR0_IOTR_MASK 0x00000001
|
||||
#define GPIO_GPCTR0_IOTR_CMD_0UTPUT 0x00000000
|
||||
#define GPIO_GPCTR0_IOTR_CMD_INPUT 0x00000001
|
||||
|
||||
int gpio_request(unsigned gpio, const char *label)
|
||||
{
|
||||
unsigned int value, off;
|
||||
|
||||
writel(GPIO_PASSWD, GPIO_BASE + GPIO_GPPWR_OFFSET);
|
||||
off = GPIO_PWD_STATUS(GPIO_BANK(gpio));
|
||||
value = readl(GPIO_BASE + off) & ~GPIO_BITMASK(gpio);
|
||||
writel(value, GPIO_BASE + off);
|
||||
|
||||
return 0;
|
||||
}
|
||||
|
||||
int gpio_free(unsigned gpio)
|
||||
{
|
||||
unsigned int value, off;
|
||||
|
||||
writel(GPIO_PASSWD, GPIO_BASE + GPIO_GPPWR_OFFSET);
|
||||
off = GPIO_PWD_STATUS(GPIO_BANK(gpio));
|
||||
value = readl(GPIO_BASE + off) | GPIO_BITMASK(gpio);
|
||||
writel(value, GPIO_BASE + off);
|
||||
|
||||
return 0;
|
||||
}
|
||||
|
||||
int gpio_direction_input(unsigned gpio)
|
||||
{
|
||||
u32 val;
|
||||
|
||||
val = readl(GPIO_BASE + GPIO_CONTROL(gpio));
|
||||
val &= ~GPIO_GPCTR0_IOTR_MASK;
|
||||
val |= GPIO_GPCTR0_IOTR_CMD_INPUT;
|
||||
writel(val, GPIO_BASE + GPIO_CONTROL(gpio));
|
||||
|
||||
return 0;
|
||||
}
|
||||
|
||||
int gpio_direction_output(unsigned gpio, int value)
|
||||
{
|
||||
int bank_id = GPIO_BANK(gpio);
|
||||
int bitmask = GPIO_BITMASK(gpio);
|
||||
u32 val, off;
|
||||
|
||||
val = readl(GPIO_BASE + GPIO_CONTROL(gpio));
|
||||
val &= ~GPIO_GPCTR0_IOTR_MASK;
|
||||
val |= GPIO_GPCTR0_IOTR_CMD_0UTPUT;
|
||||
writel(val, GPIO_BASE + GPIO_CONTROL(gpio));
|
||||
off = value ? GPIO_OUT_SET(bank_id) : GPIO_OUT_CLEAR(bank_id);
|
||||
|
||||
val = readl(GPIO_BASE + off);
|
||||
val |= bitmask;
|
||||
writel(val, GPIO_BASE + off);
|
||||
|
||||
return 0;
|
||||
}
|
||||
|
||||
int gpio_get_value(unsigned gpio)
|
||||
{
|
||||
int bank_id = GPIO_BANK(gpio);
|
||||
int bitmask = GPIO_BITMASK(gpio);
|
||||
u32 val, off;
|
||||
|
||||
/* determine the GPIO pin direction */
|
||||
val = readl(GPIO_BASE + GPIO_CONTROL(gpio));
|
||||
val &= GPIO_GPCTR0_IOTR_MASK;
|
||||
|
||||
/* read the GPIO bank status */
|
||||
off = (GPIO_GPCTR0_IOTR_CMD_INPUT == val) ?
|
||||
GPIO_IN_STATUS(bank_id) : GPIO_OUT_STATUS(bank_id);
|
||||
val = readl(GPIO_BASE + off);
|
||||
|
||||
/* return the specified bit status */
|
||||
return !!(val & bitmask);
|
||||
}
|
||||
|
||||
void gpio_set_value(unsigned gpio, int value)
|
||||
{
|
||||
int bank_id = GPIO_BANK(gpio);
|
||||
int bitmask = GPIO_BITMASK(gpio);
|
||||
u32 val, off;
|
||||
|
||||
/* determine the GPIO pin direction */
|
||||
val = readl(GPIO_BASE + GPIO_CONTROL(gpio));
|
||||
val &= GPIO_GPCTR0_IOTR_MASK;
|
||||
|
||||
/* this function only applies to output pin */
|
||||
if (GPIO_GPCTR0_IOTR_CMD_INPUT == val) {
|
||||
printf("%s: Cannot set an input pin %d\n", __func__, gpio);
|
||||
return;
|
||||
}
|
||||
|
||||
off = value ? GPIO_OUT_SET(bank_id) : GPIO_OUT_CLEAR(bank_id);
|
||||
|
||||
val = readl(GPIO_BASE + off);
|
||||
val |= bitmask;
|
||||
writel(val, GPIO_BASE + off);
|
||||
}
|
||||
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